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【モジュールリクエスト受付】MAX Vシリーズ |
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ALTERA |
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MAX V |
低コスト CPLD |
•低コストで低消費電力、高性能
•不揮発性アーキテクチャと業界最大の集積度を備えるCPLD |
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ワイヤライン通信やワイヤレス通信、産業機器、コンシューマ、コンピュータ/ストレージ、オートモーティブ、放送機器、軍用機器の各分野の製品 |
271 |
LVTTL,LVCMOS,PCI |
LVTTL(3.3/2.5/1.8V)/LVCMOS(3.3/2.5/1.8/1.5/1.2V)/PCI(3.3V) |
LVDS,RSDS |
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1.8V |
1.2V,1.5V,1.8V,2.5V,3.3V |
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MAX Vシリーズのモジュールリクエストを受け付けています。
<a href="https://www.modulestation.com/contact/request/" target="_blank"><FONT COLOR="red"><b>モジュールのリクエストはこちら ※掲載して欲しいパート・ナンバー(画面右上の表を参照下さい。)を記入します。
</b></FONT></a>図研にてリスエストを集約し、メーカー様に提供いたします。※リクエスト頂いた回路モジュール情報が掲載されることを保証するものではありません。 |
■ 低コストと低消費電力で不揮発性アーキテクチャを提供
■ インスタント・オン(0.5 ミリ秒以下)のコンフィギュレーション時間
■ わずか 25 uA の低い待機時電流、迅速なパワーダウン/ リセット動作
■ 高速伝播遅延およびClock-to-Output タイム
■ 内蔵オシレータ
■ 200 Mbps までのデータ・レートに対応しているエミュレートされたRSDS 出力をサポート
■ 304 Mbps までのデータ・レートに対応しているエミュレートされたLVDS 出力をサポート
■ ロジック・アレイ・ブロック(LAB)ごとに2 つのクロックを使用できる4 つのグローバル・クロック
■ 最大8 ビットの不揮発性情報を格納するユーザー・フラッシュ・メモリ(UFM)ブロック( 最大1000 リード/ ライト・サイクルまで)
■ デバイス・コアに電源を供給する単一の1.8V 電源
■ 3.3 V、2.5 V、1.8 V、1.5 V および1.2 V のロジック・レベルをサポートするMultiVolt I/O インタフェース
■ プログラマブル・スルー・レート、ドライブ強度、バス・ホールド、およびプログラマブル・プルアップ抵抗など、バスを扱いやすいアーキテクチャ
■ 耐ノイズ製に優れた入力を可能にするシュミット・トリガ(ピンごとにプログラム可能)
■ I/O が3.3V のPCI-SIGR PCI Local Bus Specification(Rev. 2.2)に完全準拠
■ ホット・ソケット仕様に準拠
■ IEEE Std. 1149.1-1990 準拠のJTAG(Joint Test Action Group)バウンダリ・スキャン・テスト(BST)回路を内蔵 |
MSt_CPLD_ALTERA_1st_R |
5M40ZE64
5M40ZM64
5M80ZE64
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5M160ZE64
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5M240ZM100
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5M240ZT144
5M570ZF256
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5M570ZT144
5M1270ZF256
5M1270ZF324
5M1270ZT144
5M2210ZF256
5M2210ZF324 |
CPLD 【モジュールリクエスト受付】MAX Vシリーズ ALTERA ■ 低コストと低消費電力で不揮発性アーキテクチャを提供
■ インスタント・オン(0.5 ミリ秒以下)のコンフィギュレーション時間
■ わずか 25 uA の低い待機時電流、迅速なパワーダウン/ リセット動作
■ 高速伝播遅延およびClock-to-Output タイム
■ 内蔵オシレータ
■ 200 Mbps までのデータ・レートに対応しているエミュレートされたRSDS 出力をサポート
■ 304 Mbps までのデータ・レートに対応しているエミュレートされたLVDS 出力をサポート
■ ロジック・アレイ・ブロック(LAB)ごとに2 つのクロックを使用できる4 つのグローバル・クロック
■ 最大8 ビットの不揮発性情報を格納するユーザー・フラッシュ・メモリ(UFM)ブロック( 最大1000 リード/ ライト・サイクルまで)
■ デバイス・コアに電源を供給する単一の1.8V 電源
■ 3.3 V、2.5 V、1.8 V、1.5 V および1.2 V のロジック・レベルをサポートするMultiVolt I/O インタフェース
■ プログラマブル・スルー・レート、ドライブ強度、バス・ホールド、およびプログラマブル・プルアップ抵抗など、バスを扱いやすいアーキテクチャ
■ 耐ノイズ製に優れた入力を可能にするシュミット・トリガ(ピンごとにプログラム可能)
■ I/O が3.3V のPCI-SIGR PCI Local Bus Specification(Rev. 2.2)に完全準拠
■ ホット・ソケット仕様に準拠
■ IEEE Std. 1149.1-1990 準拠のJTAG(Joint Test Action Group)バウンダリ・スキャン・テスト(BST)回路を内蔵 MAX Vシリーズのモジュールリクエストを受け付けています。
<a href="https://www.modulestation.com/contact/request/" target="_blank"><FONT COLOR="red"><b>モジュールのリクエストはこちら ※掲載して欲しいパート・ナンバー(画面右上の表を参照下さい。)を記入します。
</b></FONT></a>図研にてリスエストを集約し、メーカー様に提供いたします。※リクエスト頂いた回路モジュール情報が掲載されることを保証するものではありません。 MAXVデバイスファミリの概要.png MAX V 271 LVTTL LVCMOS PCI LVTTL(3.3/2.5/1.8V)/LVCMOS(3.3/2.5/1.8/1.5/1.2V)/PCI(3.3V) LVDS RSDS 1.8V 1.2V 1.5V 1.8V 2.5V 3.3V MSt_CPLD_ALTERA_1st_R 低コスト CPLD •低コストで低消費電力、高性能
•不揮発性アーキテクチャと業界最大の集積度を備えるCPLD ワイヤライン通信やワイヤレス通信、産業機器、コンシューマ、コンピュータ/ストレージ、オートモーティブ、放送機器、軍用機器の各分野の製品 5M40ZE64
5M40ZM64
5M80ZE64
5M80ZM64
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5M570ZT144
5M1270ZF256
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5M1270ZF256 |
MAX V |
低コスト CPLD |
•低コストで低消費電力、高性能
•不揮発性アーキテクチャと業界最大の集積度を備えるCPLD |
RoHS |
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ワイヤライン通信やワイヤレス通信、産業機器、コンシューマ、コンピュータ/ストレージ、オートモーティブ、放送機器、軍用機器の各分野の製品 |
211 |
LVTTL,LVCMOS,PCI |
LVTTL(3.3/2.5/1.8V)/LVCMOS(3.3/2.5/1.8/1.5/1.2V)/PCI(3.3V) |
LVDS,RSDS |
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1.8V |
1.2V,1.5V,1.8V,2.5V,3.3V |
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BGA系 |
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正式型番は詳細機能(温度グレード/スピードグレード/RoHS対応条件など)によって決定します。
詳細についてはメーカーにお問い合わせ下さい。 |
■ 低コストと低消費電力で不揮発性アーキテクチャを提供
■ インスタント・オン(0.5 ミリ秒以下)のコンフィギュレーション時間
■ わずか 25 uA の低い待機時電流、迅速なパワーダウン/ リセット動作
■ 高速伝播遅延およびClock-to-Output タイム
■ 内蔵オシレータ
■ 200 Mbps までのデータ・レートに対応しているエミュレートされたRSDS 出力をサポート
■ 304 Mbps までのデータ・レートに対応しているエミュレートされたLVDS 出力をサポート
■ ロジック・アレイ・ブロック(LAB)ごとに2 つのクロックを使用できる4 つのグローバル・クロック
■ 最大8 ビットの不揮発性情報を格納するユーザー・フラッシュ・メモリ(UFM)ブロック( 最大1000 リード/ ライト・サイクルまで)
■ デバイス・コアに電源を供給する単一の1.8V 電源
■ 3.3 V、2.5 V、1.8 V、1.5 V および1.2 V のロジック・レベルをサポートするMultiVolt I/O インタフェース
■ プログラマブル・スルー・レート、ドライブ強度、バス・ホールド、およびプログラマブル・プルアップ抵抗など、バスを扱いやすいアーキテクチャ
■ 耐ノイズ製に優れた入力を可能にするシュミット・トリガ(ピンごとにプログラム可能)
■ I/O が3.3V のPCI-SIGR PCI Local Bus Specification(Rev. 2.2)に完全準拠
■ ホット・ソケット仕様に準拠
■ IEEE Std. 1149.1-1990 準拠のJTAG(Joint Test Action Group)バウンダリ・スキャン・テスト(BST)回路を内蔵 |
MSt_CPLD_ALTERA_1st_R |
5M1270ZF256 |
CPLD 5M1270ZF256 ALTERA ■ 低コストと低消費電力で不揮発性アーキテクチャを提供
■ インスタント・オン(0.5 ミリ秒以下)のコンフィギュレーション時間
■ わずか 25 uA の低い待機時電流、迅速なパワーダウン/ リセット動作
■ 高速伝播遅延およびClock-to-Output タイム
■ 内蔵オシレータ
■ 200 Mbps までのデータ・レートに対応しているエミュレートされたRSDS 出力をサポート
■ 304 Mbps までのデータ・レートに対応しているエミュレートされたLVDS 出力をサポート
■ ロジック・アレイ・ブロック(LAB)ごとに2 つのクロックを使用できる4 つのグローバル・クロック
■ 最大8 ビットの不揮発性情報を格納するユーザー・フラッシュ・メモリ(UFM)ブロック( 最大1000 リード/ ライト・サイクルまで)
■ デバイス・コアに電源を供給する単一の1.8V 電源
■ 3.3 V、2.5 V、1.8 V、1.5 V および1.2 V のロジック・レベルをサポートするMultiVolt I/O インタフェース
■ プログラマブル・スルー・レート、ドライブ強度、バス・ホールド、およびプログラマブル・プルアップ抵抗など、バスを扱いやすいアーキテクチャ
■ 耐ノイズ製に優れた入力を可能にするシュミット・トリガ(ピンごとにプログラム可能)
■ I/O が3.3V のPCI-SIGR PCI Local Bus Specification(Rev. 2.2)に完全準拠
■ ホット・ソケット仕様に準拠
■ IEEE Std. 1149.1-1990 準拠のJTAG(Joint Test Action Group)バウンダリ・スキャン・テスト(BST)回路を内蔵 正式型番は詳細機能(温度グレード/スピードグレード/RoHS対応条件など)によって決定します。
詳細についてはメーカーにお問い合わせ下さい。 5M1270ZF256.png circuit_data.zip parts_list.xls cadpart.zip MAX V 211 LVTTL LVCMOS PCI LVTTL(3.3/2.5/1.8V)/LVCMOS(3.3/2.5/1.8/1.5/1.2V)/PCI(3.3V) LVDS RSDS 1.8V 1.2V 1.5V 1.8V 2.5V 3.3V 256 FBGA BGA系 MSt_CPLD_ALTERA_1st_R 5M1270ZF256 低コスト CPLD •低コストで低消費電力、高性能
•不揮発性アーキテクチャと業界最大の集積度を備えるCPLD ワイヤライン通信やワイヤレス通信、産業機器、コンシューマ、コンピュータ/ストレージ、オートモーティブ、放送機器、軍用機器の各分野の製品 RoHS 5M1270ZF256 |
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5M240ZT100 |
MAX V |
低コスト CPLD |
•低コストで低消費電力、高性能
•不揮発性アーキテクチャと業界最大の集積度を備えるCPLD |
RoHS |
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ワイヤライン通信やワイヤレス通信、産業機器、コンシューマ、コンピュータ/ストレージ、オートモーティブ、放送機器、軍用機器の各分野の製品 |
79 |
LVTTL,LVCMOS,PCI |
LVTTL(3.3/2.5/1.8V)/LVCMOS(3.3/2.5/1.8/1.5/1.2V)/PCI(3.3V) |
LVDS,RSDS |
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1.8V |
1.2V,1.5V,1.8V,2.5V,3.3V |
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100 |
TQFP |
QFP系 |
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正式型番は詳細機能(温度グレード/スピードグレード/RoHS対応条件など)によって決定します。
詳細についてはメーカーにお問い合わせ下さい。 |
■ 低コストと低消費電力で不揮発性アーキテクチャを提供
■ インスタント・オン(0.5 ミリ秒以下)のコンフィギュレーション時間
■ わずか 25 uA の低い待機時電流、迅速なパワーダウン/ リセット動作
■ 高速伝播遅延およびClock-to-Output タイム
■ 内蔵オシレータ
■ 200 Mbps までのデータ・レートに対応しているエミュレートされたRSDS 出力をサポート
■ 304 Mbps までのデータ・レートに対応しているエミュレートされたLVDS 出力をサポート
■ ロジック・アレイ・ブロック(LAB)ごとに2 つのクロックを使用できる4 つのグローバル・クロック
■ 最大8 ビットの不揮発性情報を格納するユーザー・フラッシュ・メモリ(UFM)ブロック( 最大1000 リード/ ライト・サイクルまで)
■ デバイス・コアに電源を供給する単一の1.8V 電源
■ 3.3 V、2.5 V、1.8 V、1.5 V および1.2 V のロジック・レベルをサポートするMultiVolt I/O インタフェース
■ プログラマブル・スルー・レート、ドライブ強度、バス・ホールド、およびプログラマブル・プルアップ抵抗など、バスを扱いやすいアーキテクチャ
■ 耐ノイズ製に優れた入力を可能にするシュミット・トリガ(ピンごとにプログラム可能)
■ I/O が3.3V のPCI-SIGR PCI Local Bus Specification(Rev. 2.2)に完全準拠
■ ホット・ソケット仕様に準拠
■ IEEE Std. 1149.1-1990 準拠のJTAG(Joint Test Action Group)バウンダリ・スキャン・テスト(BST)回路を内蔵 |
MSt_CPLD_ALTERA_1st_R |
5M240ZT100 |
CPLD 5M240ZT100 ALTERA ■ 低コストと低消費電力で不揮発性アーキテクチャを提供
■ インスタント・オン(0.5 ミリ秒以下)のコンフィギュレーション時間
■ わずか 25 uA の低い待機時電流、迅速なパワーダウン/ リセット動作
■ 高速伝播遅延およびClock-to-Output タイム
■ 内蔵オシレータ
■ 200 Mbps までのデータ・レートに対応しているエミュレートされたRSDS 出力をサポート
■ 304 Mbps までのデータ・レートに対応しているエミュレートされたLVDS 出力をサポート
■ ロジック・アレイ・ブロック(LAB)ごとに2 つのクロックを使用できる4 つのグローバル・クロック
■ 最大8 ビットの不揮発性情報を格納するユーザー・フラッシュ・メモリ(UFM)ブロック( 最大1000 リード/ ライト・サイクルまで)
■ デバイス・コアに電源を供給する単一の1.8V 電源
■ 3.3 V、2.5 V、1.8 V、1.5 V および1.2 V のロジック・レベルをサポートするMultiVolt I/O インタフェース
■ プログラマブル・スルー・レート、ドライブ強度、バス・ホールド、およびプログラマブル・プルアップ抵抗など、バスを扱いやすいアーキテクチャ
■ 耐ノイズ製に優れた入力を可能にするシュミット・トリガ(ピンごとにプログラム可能)
■ I/O が3.3V のPCI-SIGR PCI Local Bus Specification(Rev. 2.2)に完全準拠
■ ホット・ソケット仕様に準拠
■ IEEE Std. 1149.1-1990 準拠のJTAG(Joint Test Action Group)バウンダリ・スキャン・テスト(BST)回路を内蔵 正式型番は詳細機能(温度グレード/スピードグレード/RoHS対応条件など)によって決定します。
詳細についてはメーカーにお問い合わせ下さい。 5M240ZT100.png circuit_data.zip parts_list.xls cadpart.zip MAX V 79 LVTTL LVCMOS PCI LVTTL(3.3/2.5/1.8V)/LVCMOS(3.3/2.5/1.8/1.5/1.2V)/PCI(3.3V) LVDS RSDS 1.8V 1.2V 1.5V 1.8V 2.5V 3.3V 100 TQFP QFP系 MSt_CPLD_ALTERA_1st_R 5M240ZT100 低コスト CPLD •低コストで低消費電力、高性能
•不揮発性アーキテクチャと業界最大の集積度を備えるCPLD ワイヤライン通信やワイヤレス通信、産業機器、コンシューマ、コンピュータ/ストレージ、オートモーティブ、放送機器、軍用機器の各分野の製品 RoHS 5M240ZT100 |
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